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一種可編程全數字鎖相環(huán)的設計與實(shí)現
DOI:
CSTR:
作者:
作者單位:

(南華大學(xué) 電氣工程學(xué)院,湖南 衡陽(yáng) 421001)

作者簡(jiǎn)介:

李鳳華(1990-),女,河南商丘人,碩士研究生,主要從事電路集成與系統設計方向的研究。 單長(cháng)虹(1957-),男,湖南衡陽(yáng)人,教授,碩士研究生導師,主要從事電路集成與系統設計方向的研究。 [FQ)]

通訊作者:

中圖分類(lèi)號:

基金項目:

湖南省教育廳重點(diǎn)項目資助(14A119)。


Design and Implementation of a Programmable ADPLL
Author:
Affiliation:

(College of Electrical Engineering, University of South China, Hengyang 421001,China)

Fund Project:

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    摘要:

    針對傳統的全數字鎖相環(huán)電路參數不可調、鎖相速度慢及鎖相范圍窄的缺點(diǎn),提出了一種可編程全數字鎖相環(huán)。采用電子設計自動(dòng)化技術(shù)完成了該系統設計,并對所設計的電路進(jìn)行了計算機仿真與分析,最后,采用FPGA予以硬件電路的實(shí)現;系統仿真與硬件實(shí)驗證明,該鎖相環(huán)中數字濾波器和數控振蕩器的參數可以自主設定,改變數字濾波器的參數可加快鎖相速度,改變數控振蕩器的參數可擴大鎖相范圍;該鎖相環(huán)具有鎖相速度快、鎖相范圍寬、電路結構簡(jiǎn)單、參數設計靈活和易于集成等優(yōu)點(diǎn),可適用于許多不同用途的領(lǐng)域。

    Abstract:

    To avoid the shortcomings of traditional all digital phase-locked loop (ADPLL) on circuit parameters adjustment, low lock speed and narrow lock range, a programmable DPLL is proposed. The system design is completed by using electronic design automation(EDA) technology, while simulation and analysis of the DPLL circuit are carried through computer aided technology, and finally, the system is implemented on a FPGA hardware platform. System simulation and hardware test results verify that parameters of the digital filter and controlled oscillator of the system can be adjusted through programming, i.e. changing parameters of the digital filter leads to raising the lock speed, while changing that of the digital oscillator gives rise to broadening the lock range. The phase-locked loop is characteristic of its high lock-speed, wide lock range, simple circuit structure, flexible parameters design, and easy system integration, etc., and also it can be applied to many different areas.

    參考文獻
    相似文獻
    引證文獻
引用本文

李鳳華,劉丹丹,單長(cháng)虹.一種可編程全數字鎖相環(huán)的設計與實(shí)現計算機測量與控制[J].,2016,24(1):243-245, 248.

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歷史
  • 收稿日期:2015-07-20
  • 最后修改日期:2015-08-25
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  • 在線(xiàn)發(fā)布日期: 2016-07-26
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