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基于DSP+FPGA的實(shí)時(shí)信號采集系統設計與實(shí)現
CSTR:
作者:
作者單位:

(寶雞文理學(xué)院 物理與光電技術(shù)學(xué)院,陜西 寶雞 721016)

作者簡(jiǎn)介:

周新淳(1983-),男,陜西寶雞人,碩士研究生,講師,主要從事通信技術(shù)、單片機及嵌入式系統方向的研究。[FQ)]

通訊作者:

中圖分類(lèi)號:

基金項目:

寶雞市科技局項目(16RKX1-16);寶雞文理學(xué)院院級重點(diǎn)項目(ZK2017010)。


Design and Implementation of Real Time Signal Acquisition System Based on DSP+FPGA
Author:
Affiliation:

(Institute of Physics & Optoelectronics Technology,Baoji University of Arts and Sciences,Baoji 721016,China)

Fund Project:

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    摘要:

    為了提高對實(shí)時(shí)信號采集的準確性和無(wú)偏性,提出一種基于DSP+FPGA的實(shí)時(shí)信號采集系統設計方案。系統采用4個(gè)換能器基陣并聯(lián)組成信號采集陣列單元,對采集的原始信號通過(guò)模擬信號預處理機進(jìn)行放大濾波處理,采用TMS32010DSP芯片作為信號處理器核心芯片實(shí)現實(shí)時(shí)信號采集和處理,包括信號頻譜分析和目標信息模擬,由DSP控制D/A轉換器進(jìn)行數/模轉換,通過(guò)FPGA實(shí)現數據存儲,在PC機上實(shí)時(shí)顯示采樣數據和DSP處理結果;通過(guò)仿真實(shí)驗進(jìn)行性能測試,結果表明,該信號采集系統能有效實(shí)現實(shí)時(shí)信號采集和處理,抗干擾能力較強。

    Abstract:

    In order to improve the accuracy and bias of real-time signal acquisition, a real-time signal acquisition system based on DSP+FPGA is proposed. The system adopts 4 transducer array to build parallel array signal acquisition unit, the original signal acquisition amplification filtering through analog signal pretreatment, using TMS32010DSP chip as the core of signal processor chip to realize real-time signal acquisition and processing, including the signal spectrum analysis and target information simulation, controlled by DSP D/A converter DAC, through the realization of FPGA data storage, real-time display on the PC and DSP sampling data processing results. The performance of the system is tested by simulation. The results show that the signal acquisition system can effectively realize the real-time signal acquisition and processing, the anti-interference ability is strong.

    參考文獻
    相似文獻
    引證文獻
引用本文

周新淳.基于DSP+FPGA的實(shí)時(shí)信號采集系統設計與實(shí)現計算機測量與控制[J].,2017,25(8):210-213.

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歷史
  • 收稿日期:2017-02-22
  • 最后修改日期:2017-03-06
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  • 在線(xiàn)發(fā)布日期: 2017-09-08
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